安森美SiC CJFET：以超低RDS(on)与开关损耗重塑高压功率器件格局

在追求更高效率与功率密度的电源系统中，碳化硅（SiC）器件正加速替代传统硅基方案。而安森美（onsemi）推出的 EliteSiC 共源共栅 JFET（CJFET），凭借其独特的结构优势，在750V耐压下实现仅 5.4 mΩ 的 RDS(on)（25°C），不仅远优于600–650V竞品SiC MOSFET（后者导通电阻可达其10倍），更无需并联即可满足高电流需求，显著节省PCB空间。

CJFET的核心在于将常开型SiC JFET与低压硅MOSFET集成于单一封装，形成“cascode”结构。导通时，硅MOSFET栅极施加12–15V驱动，其沟道导通使JFET栅源电压归零，从而开启低阻通道；关断时，硅MOSFET关闭，JFET因自身夹断机制迅速阻断高压。这一机制规避了SiC MOSFET固有的高沟道电阻——后者可占总RDS(on)的60%，而CJFET中硅MOSFET的导通电阻仅贡献约10%。

更关键的是其动态性能优势。实测显示，在40A关断电流下，UJ4SC075018B7S CJFET的关断能量损耗（Eoff）比主流SiC MOSFET低近5倍。尽管其导通损耗（Eon）略高（源于内部电容），但在LLC等零电压开关（ZVS）拓扑中，Eon几乎为零，此时CJFET的综合开关损耗可降低高达三分之一。

此外，CJFET在第三象限续流阶段表现卓越。得益于JFET常开特性，即使栅极为0V，反向电流仍能自动开启沟道，实现同步整流。测试表明，在30A反向电流下，其体二极管压降仅约2.45V，远低于SiC MOSFET的4.8V，大幅降低死区时间内的导通损耗。同时，其整流关断损耗（Erec）随电流升高而下降，进一步优化系统效率。

驱动方面，CJFET展现出极高的灵活性：仅需9V栅压即可接近完全导通，若采用10V而非15V驱动，栅极电荷（QG）可减少30%（12 nC），有效降低高频应用中的驱动损耗，且不影响RDS(on)。

面向更高集成需求，安森美还推出Combo JFET架构——将SiC JFET与Si MOSFET芯片垂直堆叠，并分别引出双栅极。这种设计不仅提升散热效率（JFET直连铜基底），还允许通过外部电阻独立调节开关速度，实现多器件并联下的均流与振荡抑制。

综上，安森美SiC CJFET以超低导通电阻、极优开关特性、自动同步整流与灵活驱动，正在光伏逆变器、车载充电机、服务器电源及工业电机驱动等领域，成为超越传统SiC MOSFET的高效新选择。

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