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尽管LDO电路原理简单，但其实际性能极易受PCB布局缺陷影响。不当布线会引发噪声耦合、稳定性下降、温升过高甚至振荡。以下是五类最常见且危害严重的PCB布局错误。
1. 输入/输出电容远离LDO引脚
许多设计者将去耦电容随意放置在附近区域，却未紧贴LDO的VIN和VOUT引脚。长走线引入寄生电感（nH级），在高频下形成阻抗，削弱电容的滤波能力。后果包括：输入端无法有效抑制DC-DC开关噪声；输出端相位裕度降低，可能引发高频振荡。正确做法：CIN和COUT焊盘应直接连接LDO引脚，避免过孔或拐角。
2. 接地（GND）处理不当
LDO的GND引脚是内部误差放大器的参考点。若将其通过细长走线连接至远处地平面，或与DC-DC功率地共用路径，高di/dt电流将产生地弹噪声，导致输出电压漂移或纹波增大。正确做法：采用“星型接地”或“单点接地”，将LDO GND直接连至干净的模拟地平面，并远离开关节点。
3. 散热焊盘未有效连接内层铜皮
带顶部散热焊盘（Exposed Pad）的LDO封装（如DFN、WSON）若仅焊接表面而未通过多个热过孔连接至内层大面积GND铜箔，热量无法有效导出。结温迅速升高，不仅增大压差电压（VDO），还可能触发过热关断。正确做法：在焊盘下方打6–9个热过孔，连接至至少两层内层GND平面。
4. LDO输出走线靠近高噪声信号
将LDO输出走线与DC-DC的SW节点、时钟线或高速数字信号平行布线，会通过容性或感性耦合引入干扰。即使LDO本身PSRR良好，高频噪声仍可能穿透，表现为输出叠加MHz级杂散。正确做法：LDO输出走线应短而直，远离噪声源；必要时用地线屏蔽隔离。
5. 可调LDO反馈网络布局松散
对于可调输出LDO（如TPS7Axx系列），FB引脚与反馈电阻构成高阻抗敏感节点。若R1/R2远离FB引脚或走线跨分割平面，易拾取EMI，导致输出电压波动或不稳定。正确做法：反馈电阻紧贴FB引脚放置，走线短且不跨地分割；可在FB到GND间加10–100pF小电容滤除高频噪声。
其他易忽略问题：
在LDO下方布设高速信号线（尤其无完整地平面时）；
使用Y5V等高TCR、低稳定性的陶瓷电容；
多电源域未合理隔离，造成串扰。
总结：
LDO的“简单”仅存在于原理图层面。90%以上的现场失效源于PCB布局错误。通过优化电容位置、接地策略、热设计与噪声隔离，才能充分发挥LDO低噪声、高稳定性的优势，确保系统可靠运行。
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